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功耗最低的128宏单元CPLD

6.0 ns的引脚对引脚的逻辑延迟

?#20302;?#39057;率高达145 MHz的

128个宏单元3000可用门

可在小型封装

- 144引脚TQFP ( 108个用户I / O引脚)

- 144球BGA CS ( 108个用户I / O)

- 100引脚VQFP ( 84个用户I / O)

优化3.3V?#20302;?/p>

- 超低功耗运行

- 5V容限I / O引脚3.3V内核电源

- 先进的0.35微米五层金属EEPROM

过程

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技术

先进的?#20302;?#21151;能

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- 输入寄存器

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- 最多每个功能块23可用的时钟

- 在设计变更优秀销固定

- 完整的IEEE标准1149.1边界扫描( JTAG )

- 四个全局时钟

- 每个功能块八乘积项控制项

快速ISP编程时间

端口使能引脚额外的I / O

2.7V至在工业温度3.6V电源电压

范围

每路输出可编程转换速率控制

安全位可以防止未经授权的访问

请参阅XPLA3系列数据表( DS012 )的

体系结构描述



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